明德扬周老师 发表于 2019-9-28 14:22:15

MP801开发板硬件介绍

1、总体介绍下图总体展示了明德扬MP801开发板的硬件资源。如下所示: 明德扬MP801开发板板载众多的外设,从简单的led到复杂的sdram等一应俱全,其中板载EP4CE15F23C8,拥有15K逻辑资源,504K bit ram资源,且板载3片128Mbit sdram,适合存储大容量的数据;并且拥有125Mhz 双通道转换速率的高速并行DA芯片AD9709和32Mhz 转换速率的高速并行AD芯片AD9280,编程简单,适用做算法验证;并且采用64M spi flash存储器存储程序,满足开发需求。 2.Led 灯原理图如下所示:
开发板led电路采用上拉接法,板载8个绿色的led。在开发板的实际位置如下所示:
3.数码管板载红色8个数码管,采用动态显示的方式和fpga连接,其中数码管采用共阳极数码管,实际在开发板上的位置如下所示:
4.拨码开关   拨码开关原理图如下所示,用户可以使其电平一直为0或1。         实际在开发板上的位置如下所示(下面为逻辑0,上面为逻辑1): 5.普通按键 与 复位按键按键原理图如下所示,开发板采用4个独立按键加一个复位按键,其中最左边是复位按键,且采用上拉的接法,默认为1,当按键按下时,按键的电平被拉低。                   在开发板中的实际位置如下: 6.蜂鸣器      蜂鸣器采用有源蜂鸣器,原理图如下所示,蜂鸣器使用pnp三极管驱动,当fpga驱动引脚电平为0,蜂鸣器会发出声响。       在开发板中的实际位置如下: 7.温度传感器   温度传感器采用ds18b20,用户可以实时检测周围的温度。在开发板中的实际位置如下所示: 8.EEPROM 存储器板载AT93C46存储器,拥有1K bit的容量,存储时间100年,满足用户存储需要掉电保存的数据。实际在开发板中的位置如下所示: 9.vga显示 Vga显示使用16bit数据线,可以显示65536种颜色,在开发板中的位置如下所示。 10. sdram存储器明德扬MP801开发板采用三片128Mbit sdram,满足大容量存储数据的需求,实际位置如下所示: 11. 千兆网口板载rtl8211芯片,实现千兆网,1G的带宽,满足用户传输大容量数据的要求。实际在开发板中的位置如下所示: 12. usb串口   板载CH340芯片,实现usb转串口,当用户通过usb线连接开发板和pc后,便可使用串口助手和fpga通信。实际位置如下所示: 13. AD9709板载双通道、125Mhz转换速率、8bit、高速DA芯片,满足常用信号发生器、滤波信号输出等需求。实际位置如下所示: 14. AD9280板载32Mhz 转换速率、8bit高速AD芯片,满足各种信号的采集,满足用户实现各种常见滤波算法的实现。实际位置如下所示:
15. 其他介绍本开发板预留常见cmos接口,其中P8兼容ov7670/5640/7725摄像头,在开发板中的位置如下所示。     注:这两个都是一样的接口,只是一个是直针一个是弯针,并不影响实际使用,后续版本统一为90°弯针(上图左)。 同时,本开发板拥有TFT屏幕接口,tft屏幕后续推出,尽请期待。


同时,开发板预留一些未用的接口,对应的标号为P12和P13,在开发板中的位置如下所示。 最后,开发板提供5V、3.3V电源输出,对应的标号为P10,在开发板中的位置如下所示。 附录:明德扬开发板尺寸信息:长 * 宽 130mm * 100mmpcb: 6层镀金工艺。
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MP801常见问题
【问题1】USB串口可以用来传图片数据吗?速度是多少?【回答】:            本开发板虽然使用的是USB接口,但实质上是串口。串口的速率不会很高,通常只用于控制等场景。图片是可以传输的,一般会比较慢。          1. 如果本板是与电脑、STM32等器件相连,则一般有标准的串口速率,如9600、115200等,一般不会超过1Mbps速率。速度越高,对FPGA设计要求越高。          2. 如果是MP801与另一款MDY的板子相连,在保证通信成功的前提下,双方可以约定具体的速率,一般不会超过2Mbps速率。
【问题2】801开发板 能处理数字视频信号吧?并在视频上字符叠加?
   回答:论坛提供的边缘检测案例使用的是数字视频,所以本开发板支持数字视频的采集和处理。在视频上添加字符也是支持的
【问题3】801开发板的ROM,其存储最大深度是65536吗?   回答:801开发板搭载的芯片是EP4CE15F23C8,内部的RAM资源是504kb。注意,这是FPGA芯片内部总的RAM大小,但实质使用时会收到限制,不可能全部用完,具体可参考 FPGA M9K不够用问题             另外,还要注意,在生成RAM/ROM IP核的时候,会要求选择深度。这个深度只是这个RAM/ROM IP核的“设计深度”,相当于代码的深度,这个深度能不能放进FPGA芯片,需要在布局布线才能确认。
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