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预览 时序约束培训视频课程 基于VIVADO attach_img admin 2020-1-5 017092 admin 2020-1-5 11:43
预览 在signaltap里,怎么把综合优化掉的信号捕捉出来 +1 陈老师 2019-12-10 027761 陈老师 2019-12-10 11:30
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预览 begin和end什么时候必须要有,什么时候可以没有 陈老师 2019-12-10 026897 陈老师 2019-12-10 11:27
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预览 FPGA中如何表示正负? 陈老师 2019-12-10 09305 陈老师 2019-12-10 11:20
预览 always引导的组合逻辑和assign引导的组合逻辑有什么区别,以及如何选择 陈老师 2019-12-10 06140 陈老师 2019-12-10 11:18
预览 阻塞赋值与非阻塞赋值的区别 陈老师 2019-12-10 05612 陈老师 2019-12-10 11:15
预览 什么时候进行打拍操作?打多少拍? 陈老师 2019-12-10 05583 陈老师 2019-12-10 11:14
预览 什么时候用组合逻辑、什么时候用时序逻辑 陈老师 2019-12-10 05425 陈老师 2019-12-10 11:13
预览 在各个文件中,如何确定信号是reg型还是wire型? 陈老师 2019-12-10 05147 陈老师 2019-12-10 11:12
预览 modelsim仿真改进制 陈老师 2019-12-10 05054 陈老师 2019-12-10 11:11
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